总线读操作
当8086
cpu进行存储器或i/o端口读操作时,总线进入读周期,8086的读周期时序,基本的读周期由4个t周期组成:t1,t2,t3和t4.当所选中的存储器和外设的存取速度较慢时,则在t3和t4之间将插入一个或几个等待周期tw.
8086读周期时序:
在8086读周期内,有关总线信号的变化如下:
(1)
m/io在整个读周期保持有效,当进行存储器读操作时,m/io为高电平;当进行i/o端口读操作时,m/io为低电平.
(2)
a19/s6~a16/s3是在t1期间,输出cpu要读取的存储单元的地址高4位.t2~t4期间输出状态信息s6~s3.
(3)
bhe/s7在t1期间输出bhe有效信号(bhe为低电平),表示高8位数据总线上的信息可以使用,bhe信号通常作为奇地址存储体的选择信号(偶地址存储体的选择信号是最低地址位a0).t2~t4期间输出高电平.
(4)
adl5~ad0在t1期间输出cpu要读取的存储单元或i/o端口的地址a15~a0.t2期间为高阻态,t3~t4期间,存储单元或i/o端口将数据送上数据总线.cpu从adl5~ad0上接收数据.
(5)
ale:在t1期间地址锁存有效信号,为一正脉冲,系统中的地址锁存器正是利用该脉冲的下降沿来锁存a19/s6~a16/s3,adl5~ad0中的20位地址信息以及bhe.
(6)rd在t2期间输出低电平,送到被选中的存储器或i/o接口.要注意的是,只有被地址信号选中的存储单元或i/o端口,才会被rd信号从中读出数据(数据送上数据总线adl5~ad0).
(7)
dt/r在整个总线周期内保持低电平,表示本总线周期为读周期.在接有数据总线收发器的系统中,用来控制数据传输的方向.
(8)
den在t2~t3期间输出有效低电平,表示数据有效.在接有数据总线收发器的系统中,用来实现数据的选通.
总线写操作
8086写周期时序
总线写操作的时序与读操作时序相似,其不同处在于:
(1)
adl5~ad0在t2~t4期间送上欲输出的数据,而无高阻态.
(2)
wr在t2~t4期间输出有效低电平,该信号送到所有的存储器和i/o接口.要注意的是,只有被地址信号选中的存储单元或i/o端口才会被wr信号写入数据.
(3)
dt/r在整个总线周期内保持高电平,表示本总线周期为写周期.在接有数据总线收发器的系统中,用来控制数据传输方向.
3)
中断响应操作
当8086
cpu的intr引脚上有一有效电平(高电平),且标志寄存器中if=1,则8086
cpu在执行完当前的指令后,响应中断.在响应中断时cpu执行两个中断响应周期,
额,追加点分数哈!谢谢!
温馨提示:答案为网友推荐,仅供参考